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Open Menu / include / dt-bindings / clock / qcom,gcc-msm8976.h
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/* SPDX-License-Identifier: (GPL-2.0-only OR BSD-2-Clause) */
/*
 * Copyright (C) 2016, The Linux Foundation. All rights reserved.
 * Copyright (C) 2016-2021, AngeloGioacchino Del Regno
 *                     <angelogioacchino.delregno@somainline.org>
 */

#ifndef _DT_BINDINGS_CLK_MSM_GCC_8976_H
#define _DT_BINDINGS_CLK_MSM_GCC_8976_H

#define GPLL0					0
#define GPLL2					1
#define GPLL3					2
#define GPLL4					3
#define GPLL6					4
#define GPLL0_CLK_SRC				5
#define GPLL2_CLK_SRC				6
#define GPLL3_CLK_SRC				7
#define GPLL4_CLK_SRC				8
#define GPLL6_CLK_SRC				9
#define GCC_BLSP1_QUP1_SPI_APPS_CLK		10
#define GCC_BLSP1_QUP1_I2C_APPS_CLK		11
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#define GCC_BLSP1_QUP2_SPI_APPS_CLK		13
#define GCC_BLSP1_QUP3_I2C_APPS_CLK		14
#define GCC_BLSP1_QUP3_SPI_APPS_CLK		15
#define GCC_BLSP1_QUP4_I2C_APPS_CLK		16
#define GCC_BLSP1_QUP4_SPI_APPS_CLK		17
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#define GCC_BLSP1_UART2_APPS_CLK		19
#define GCC_BLSP2_QUP1_I2C_APPS_CLK		20
#define GCC_BLSP2_QUP1_SPI_APPS_CLK		21
#define GCC_BLSP2_QUP2_I2C_APPS_CLK		22
#define GCC_BLSP2_QUP2_SPI_APPS_CLK		23
#define GCC_BLSP2_QUP3_I2C_APPS_CLK		24
#define GCC_BLSP2_QUP3_SPI_APPS_CLK		25
#define GCC_BLSP2_QUP4_I2C_APPS_CLK		26
#define GCC_BLSP2_QUP4_SPI_APPS_CLK		27
#define GCC_BLSP2_UART1_APPS_CLK		28
#define GCC_BLSP2_UART2_APPS_CLK		29
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#define GCC_SDCC1_APPS_CLK			90
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#define GCC_BLSP1_AHB_CLK			110
#define GCC_BLSP2_AHB_CLK			111
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#define GCC_CRYPTO_AHB_CLK			113
#define GCC_CRYPTO_AXI_CLK			114
#define GCC_CRYPTO_CLK				115
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#define GCC_APSS_TCU_CLK			117
#define GCC_JPEG_TBU_CLK			118
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#define GCC_MDP_TBU_CLK				120
#define GCC_SMMU_CFG_CLK			121
#define GCC_VENUS_1_TBU_CLK			122
#define GCC_VENUS_TBU_CLK			123
#define GCC_VFE1_TBU_CLK			124
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#define BLSP2_QUP2_I2C_APPS_CLK_SRC		143
#define BLSP2_QUP2_SPI_APPS_CLK_SRC		144
#define BLSP2_QUP3_I2C_APPS_CLK_SRC		145
#define BLSP2_QUP3_SPI_APPS_CLK_SRC		146
#define BLSP2_QUP4_I2C_APPS_CLK_SRC		147
#define BLSP2_QUP4_SPI_APPS_CLK_SRC		148
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#define MDP_CLK_SRC				173
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#define SDCC1_APPS_CLK_SRC			177
#define SDCC1_ICE_CORE_CLK_SRC			178
#define SDCC2_APPS_CLK_SRC			179
#define SDCC3_APPS_CLK_SRC			180
#define USB_FS_IC_CLK_SRC			181
#define USB_FS_SYSTEM_CLK_SRC			182
#define USB_HS_SYSTEM_CLK_SRC			183
#define VCODEC0_CLK_SRC				184
#define GCC_MDSS_BYTE0_CLK_SRC			185
#define GCC_MDSS_BYTE1_CLK_SRC			186
#define GCC_MDSS_BYTE0_CLK			187
#define GCC_MDSS_BYTE1_CLK			188
#define GCC_MDSS_PCLK0_CLK_SRC			189
#define GCC_MDSS_PCLK1_CLK_SRC			190
#define GCC_MDSS_PCLK0_CLK			191
#define GCC_MDSS_PCLK1_CLK			192
#define GCC_GFX3D_CLK_SRC			193
#define GCC_GFX3D_OXILI_CLK			194
#define GCC_GFX3D_BIMC_CLK			195
#define GCC_GFX3D_OXILI_AHB_CLK			196
#define GCC_GFX3D_OXILI_AON_CLK			197
#define GCC_GFX3D_OXILI_GMEM_CLK		198
#define GCC_GFX3D_OXILI_TIMER_CLK		199
#define GCC_GFX3D_TBU0_CLK			200
#define GCC_GFX3D_TBU1_CLK			201
#define GCC_GFX3D_TCU_CLK			202
#define GCC_GFX3D_GTCU_AHB_CLK			203

/* GCC block resets */
#define RST_CAMSS_MICRO_BCR			0
#define RST_USB_HS_BCR				1
#define RST_QUSB2_PHY_BCR			2
#define RST_USB2_HS_PHY_ONLY_BCR		3
#define RST_USB_HS_PHY_CFG_AHB_BCR		4
#define RST_USB_FS_BCR				5
#define RST_CAMSS_CSI1PIX_BCR			6
#define RST_CAMSS_CSI_VFE1_BCR			7
#define RST_CAMSS_VFE1_BCR			8
#define RST_CAMSS_CPP_BCR			9
#define RST_MSS_BCR				10

/* GDSCs */
#define VENUS_GDSC				0
#define VENUS_CORE0_GDSC			1
#define VENUS_CORE1_GDSC			2
#define MDSS_GDSC				3
#define JPEG_GDSC				4
#define VFE0_GDSC				5
#define VFE1_GDSC				6
#define CPP_GDSC				7
#define OXILI_GX_GDSC				8
#define OXILI_CX_GDSC				9

#endif /* _DT_BINDINGS_CLK_MSM_GCC_8976_H */